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z8820 PXIe直流电源与数字IO控制器|LitePoint (停产)
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LitePoint
z8820 直流电源与数字 IO 控制器
2 路 DB-26H 控制总线 · +6V/+9V/-13V 供给 · 3.3V CMOS 数字 IO · 控 z475 与 z8812
产品简介
z8820 是**远端设备的控制中枢**。
远端电源 z475、端口模块 z8812 这类设备本身不带 PXI 总线接口，靠 z8820 通过 DB-26H 控制总线去管——两路 DB-26H，一路挂一组。
它自己也有供电输出：**+6V/3.0A、+9V/1.5A、-13V/0.5A**，上电时间分别 <75ms、<125ms、<125ms。
三路电压的时序可以直接由它编排，这对需要多路上下电顺序的芯片测试是实用功能，不必再外接继电器。
数字 IO 是 3.3V CMOS，带 **SPI 接口**（SPI_CLK 52MHz、DWR 26Mbps、DRD 26Mbps），另有若干通用 DIO。
也就是说，控制远端板上的寄存器、读回状态，都可以走这一条 SPI 链路，不需要额外的通信卡。
走 PCIe Gen1 x1 与主机相连。
PXIe 形态的直流电源与数字 IO 控制中枢，管理远端电源与负载板。
核心参数
• 主机接口：PCI Express Gen1 x1
• 控制总线：2 路 DB-26H（各带一组直流电源与数字 IO）
• 直流输出：+6V/3.0A（18W）、+9V/1.5A（13.5W）、-13V/0.5A（6.5W）
• 上电时间：< 75ms（+6V）、< 125ms（+9V、-13V）
• 数字 IO 电平：3.3V CMOS，0 至 3.3V
• 输出驱动：±20mA（VOH 2.4V / VOL 0.55V）
• SPI 时钟：52MHz（SPI_CLK）
• SPI 数据率：26Mbps（DWR / DRD）
• PXIe 供电：+3.3V 最大 3.25A；+12V 最大 3.25A
• 配套设备：z475 远端电源、z8812 端口模块
功能特性
• 两路控制总线：一组 DB-26H 带一组远端设备，两组互不干扰。
• 三路板载供电：+6V/+9V/-13V，覆盖常见芯片与运放供电需求。
• 上电时序可控：三路上电时间不同，可按需编排先后顺序。
• SPI 主控通道：52MHz 时钟，够控远端板上的寄存器与状态机。
• 通用数字 IO：3.3V CMOS，可做使能、中断与状态读取。
• 远端设备管理：z475、z8812 这类不带总线的设备由它统一接入。
• PXIe 供电余量足：+3.3V 与 +12V 各 3.25A，带多个远端负载不紧张。
• 标准驱动支持：C/C++、LabVIEW、COM 等驱动可直接调用。
应用场景
• 远端电源控制：一台控制器带两组 z475，多工位独立供电。
• 端口模块切换：控制 z8812 端口模块的射频路由。
• 芯片上下电时序：多路电源按序上电，验证时序敏感型器件。
• 夹具内数字控制：SPI 与 DIO 直连夹具内的控制板。
• 负载板管理：远端电子负载与测试板的供电与通信。
• ATE 系统集成：作为 PXIe 系统的供电与数字控制单元。
• 产线治具：治具内的继电器、传感器由它驱动。
• 低功耗测试：为待测件提供低噪声的固定电压轨。
资源下载
以上内容与指标均取自LitePoint（莱特波特）（LitePoint）官网该产品详情页与官方产品资料，未标注口径的为厂家公布值。
LitePoint · onetest 仪器资源库
LitePoint
z8820 直流电源与数字 IO 控制器 详细指标
2 路 DB-26H 控制总线 · +6V/+9V/-13V 供给 · 3.3V CMOS 数字 IO · 控 z475 与 z8812
详细指标
指标取自 LitePoint 官方技术规格书（PDF）。该型号官方已标注 Discontinued（停产），本站仍保留其页面与指标供存量系统参考。
前面板
• Channel 1：DB-26H ｜ DC power supplies and digital IO control bus #1
• Channel 2：DB-26H ｜ DC power supplies and digital IO control bus #2
• 1：DIO1 SPI_CLK ｜ 3.3V CMOS (52 MHz) ｜ 25Ω ± 15% ｜ 3.6 V ｜ 0 V to 3.3 V ｜ -0.3 V ｜ ±20 mA ｜ SPI Master Clock
• 10：DIO2 SPI_DWR ｜ 3.3V CMOS (26 Mbps) ｜ 25Ω ± 15% ｜ 3.6 V ｜ 0 V to 3.3 V ｜ -0.3 V ｜ ±20 mA ｜ SPI Master Write Data
• 2：DIO_D3 SPI_DRD ｜ 3.3V CMOS (26 Mbps) ｜ 25Ω ± 15% ｜ 3.6 V ｜ 0 V to 3.3 V ｜ -0.3 V ｜ ±20 mA ｜ SPI Master Read Data
• 11：DIO_D4 ｜ 3.3V CMOS ｜ 25Ω ± 15% ｜ 3.6 V ｜ 0 V to 3.3 V ｜ -0.3 V ｜ ±20 mA
• 3：DIO_D5 ｜ 3.3V CMOS ｜ 25Ω ± 15% ｜ 3.6 V ｜ 0 V to 3.3 V ｜ -0.3 V ｜ ±20 mA
• 12：DIO_D6 ｜ 3.3V CMOS ｜ 25Ω ± 15% ｜ 3.6 V ｜ 0 V to 3.3 V ｜ -0.3 V ｜ ±20 mA
• 4：DIO_D7 ｜ 3.3V CMOS ｜ 25Ω ± 15% ｜ 3.6 V ｜ 0 V to 3.3 V ｜ -0.3 V ｜ ±20 mA
• 13：DIO_D8 ｜ 3.3V CMOS ｜ 25Ω ± 15% ｜ 3.6 V ｜ 0 V to 3.3 V ｜ -0.3 V ｜ ±20 mA
• 5, 14, 22：+6V ｜ DC Power ｜ - ｜ 6.1 V ｜ 6.0 V ｜ 5.7 V ｜ 3.0 A ｜ 1.5 A per channel
• 7, 16, 24：+9V ｜ DC Power ｜ - ｜ 9.1 V ｜ 9.0 V ｜ 8.75 V ｜ 1.5 A ｜ 0.75 A per channel
• 9, 18, 26：-13V ｜ DC Power ｜ - ｜ -13.0 V ｜ -13.2 V ｜ -13.4 V ｜ 0.5 A ｜ 0.25 A per channel
• 6, 7, 8, 15, 17, 19, 20, 21, 23, 25：GND ｜ Ground ｜ - ｜ - ｜ 0 V ｜ - ｜ -
Buffer
• V Imax：Voltage – In ｜ -0.3 ｜ 3.6 ｜ V
• V Omax：Voltage – Output ｜ 0.0 ｜ 3.3 ｜ V
• V IH：Voltage – High-level Input ｜ 2.0 ｜ V
• V IL：Voltage – Low-level Input ｜ 0.8 ｜ V
• V OH：Voltage – High-level Output, IOH = -20mA ｜ 2.4 ｜ V
• V OL：Voltage – Low-level Output, IOL = 20mA ｜ 0.55 ｜ V
• I OH：Current – High-level Output ｜ -20 ｜ mA
• I OL：Current – Low-level Output ｜ 20 ｜ mA
• I I：Current – Input (High/Low) ｜ ±2 ｜ µA
• t PLH：Switching – Low to High ｜ 0.7 ｜ 5.8 ｜ ns
• t PHL：Switching – High to Low ｜ 0.8 ｜ 5.0 ｜ ns
• Z SOURCE：Source Impedance ｜ 25 ｜ Ω
• V ESD：Voltage – ESD Protection ｜ ±8 ｜ kV
• V CL：Clamp Voltage: Positive Transients Negative Transients ｜ +9.2 -1.6 ｜ V V
• C IN：Input Capacitance ｜ 20 ｜ pF
• 1 foot：Mbps ｜ Mbps
• 5 feet：Mbps ｜ Mbps
• 10 feet：Mbps ｜ Mbps
• 15 feet：Mbps ｜ Mbps
DC Power Supplies
• +6 V Supply：3.0 A ｜ 18 W ｜ < 75 ms
• +9 V Supply：1.5 A ｜ 13.5 W ｜ < 125 ms
• -13 V Supply：0.5 A ｜ 6.5 W ｜ < 125 ms
• +3.3 V PXIe Current：0.25 A ｜ 2.50 A ｜ 3.25 A
• +12 V PXIe Current：0.10 A ｜ 2.50 A ｜ 3.25 A
• Total PXIe Power：2 W ｜ 40 W ｜ 51 W
• Total PXIe Cooling：2 W ｜ 11 W ｜ 13 W
Clock Generator
• Output Clock Rates：25 kHz to 100 MHz
• Master Clock Rates：MCLKA: 25 MHz MCLKB: 80 MHz to 230 MHz, programmable
• Clock Generator Signals (sourced from MCLKA or MCLKB)：CLK_GEN1: MCLKA or B with programmable 10-bit divider CLK_GEN2: MCLKA or B with programmable 7-bit divider CLK_GEN3: MCLKA or B with programmable 7-bit divider By default, CLK_GEN3 is 10 MHz and used for SPI bus
• Clock Routing (CLK_GEN1-3)：DIO1-8 Channels 1-2 PXI_TRIG[0:7]
PXIe 接口
• PXIe Slot Compatibility：PXIe Slot and PXIe Hybrid Slot Compatible
• PCI Express Interface：Lane, Gen 1, 2.5 Gbps
• Geographical Addressing：Supported per PXIe specification 2.2.4
• PXI Timing & Triggering Signals：PXI_TRIG[0:7] input/output PXI_STAR input PXI_CLK10 input PXI_CLK100 input
物理与环境
• 尺寸：Single-Wide 3U PXIe Instrument 8.25” x 0.79” x 5.25” (L x W x H) 20.96 cm x 2.01 cm x 13.34 cm (L x W x H)
• 重量：6.3 oz. (178 g)
• 工作条件：0°C to +40°C ambient (MIL-PRF28800F Class 3)
• 存储：-40°C to +75°C (MIL-PRF28800F Class 3)
• Operating or Storage Up to +30°C +30°C to +40°C above +40 °C：5 to 95% ± 5% non-condensing 5 to 75% ± 5% non-condensing 5 to 45% ± 5% non-condensing
资源下载
以上规格取自 LitePoint 官方技术规格书（PDF）与官网产品页；标注「典型」的为厂家典型值。
LitePoint · onetest 仪器资源库
全部
LitePoint官方渠道
官方渠道（官网 / 热线 / 邮箱）
• 官网 www.litepoint.com
• 产品询价与授权代理查询 www.litepoint.com/contact/
• 技术支持与资料下载 www.litepoint.com/support/
• LitePoint 为泰瑞达（Teradyne）旗下公司，中国区由原厂销售与授权代理共同覆盖，具体代理名录以厂商官方答复为准
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